【INTEL(ALTERA)】 quartus 使用F-Tile HDMI IP 编译时间长怎么办

2023-12-18 12:30:02

说明

由于采用固定速率链路 (FRL) 的 F-Tile HDMI 英特尔? FPGA IP设计示例中存在 SDC 问题,用于生成重新配置文件的 SDC 约束导致 fitter 阶段在编译期间花费更长的时间。


解决方法

对于英特尔? Quartus? Prime Pro Edition 软件版本 22.3,可提供修补程序来修复此问题。

通过以下链接下载安装?0.45 补丁

对于英特尔? Quartus? Prime Pro Edition 软件版本 22.4,可提供修补程序来修复此问题。

通过以下链接下载安装?0.28 补丁

从 英特尔? Quartus? Prime 专业版软件的 23.1 版开始,此问题已修复。

文章来源:https://blog.csdn.net/sqqwm/article/details/134996082
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